Pogo-Sonde aus plattiertem Gold

Pogo-Sonde aus plattiertem Gold

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Angesichts der unterschiedlichen physikalischen Natur der Struktur werden Sie unterschiedliche Fehlermodi sehen. Aber im Großen und Ganzen ist der Test von den einzelnen Transistoren abstrahiert, also weiß ich nicht, ob Sie einen großen Unterschied sehen werden. Jedes Mal, wenn die Branche eine dieser großen architektonischen Änderungen durchläuft, sehen Sie in der Regel einen Anstieg der Testintensität. Sie müssen herausfinden, was die Fehlermodi sind, die mit dieser neuen Transistorstruktur verbunden sind, und die gesamte physikalische Architektur. Wir haben etwas davon an den ersten finFET-Knoten gesehen, sei es 22 nm im Mikroprozessorraum oder 14/16 nm im Gießereiraum.

Pogo-Sonde aus plattiertem Gold

Ein gutes Beispiel dafür sind die Leistungsentfaltungs- und/oder Leistungsimpedanzspezifikationen in der Sondenkarte. Wenn Sie versuchen, all diese Leistung von der Testinstrumentierung in den Chip zu liefern, wird der Weg, auf dem Sie dies tun, viel wichtiger und die Spezifikationen müssen viel enger sein. Vor fünf Jahren war die Leistungsabgabeleistung der Sondenkarte keine so große Sache. Jetzt ist es eine wichtige Designüberlegung, und es ist einer der Gründe, warum wir am Ende so eng mit Fabless-Kunden zusammenarbeiten. Sie verstehen die unterschiedlichen Toleranzen und Spezifikationen, die jedes dieser Netzteile haben wird. Einige sind etwas lockerer, andere müssen extrem eng sein. Wenn Sie die für jedes Design spezifische Sondenkarte entwerfen, wird dies zu einem der Hauptleistungsprobleme.

Pogo-Sonde aus plattiertem Gold

Fast alles, was wir tun, ist entweder Bare Die oder Full Wafer, so dass die Verpackung am Ende ein nachgeschaltetes Stück davon ist. Aber Sie sehen viele der gleichen Implikationen, die mit der Stromversorgung verbunden sind, die am Ende Einschränkungen im Paketdesign sind. Historisch gesehen waren verpackte Substrate ziemlich einfache Strukturen - ein paar Schichten Metall, nicht viele wirklich strenge Designanforderungen. Das hat sich geändert. Jetzt sehen wir viel kompliziertere Verpackungssubstrate mit mehr Schichten. Die Via-Dichten steigen stark an. Sie müssen die Stromversorgungsleistung verwalten und anpassen. Dies wird zu einer großen Sache - nicht nur für Tests auf Wafer-Ebene mit einer Sondenkarte, sondern auch im endgültigen Paket.

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Sie testen, um sicherzustellen, dass jede dieser Komponentenformen funktional gut ist oder gut genug, um in der endgültigen Verpackung repariert zu werden. Und weil sie auf ziemlich fortschrittlichen Knoten hergestellt werden - mindestens 1x oder 1y Nanometer DRAM-Knoten - sind die Ausbeuten nicht groß. Und so ist es eine einfache funktionale Charakterisierung, um sicherzustellen, dass der Würfel, der in den Stapel geht, so gut wie möglich ist. Ich zögere, den Begriff "bekanntermaßen gute Matrize" zu verwenden, weil er die Vorstellung einer perfekten Sache vermittelt, und nichts in der Halbleiterindustrie ist perfekt. Es gibt ein ausgewogenes Verhältnis zwischen Kosten und dem Risiko, mit dem die Leute ständig spielen, und für DRAM gibt es ein gewisses Maß an Reparierbarkeit und Redundanz. Sie sehen also, wie all diese verschiedenen Knöpfe ausgeübt werden. Aber HBM hat sicherlich nicht nur das Volumen unseres DRAM-Probekartengeschäfts beeinflusst, sondern auch die Spezifikationsanforderungen, da sie diese weiter verschärfen.

Für den Zuverlässigkeitsaspekt einiger dieser neueren Geräte finden die Leute dies immer noch heraus. Aber es gibt Dinge, die analog zu Burn-in- und beschleunigten Tests sind, entweder durch Temperatur- oder Vibrationstests. Sie finden verschiedene Wege, um die wahrscheinlichsten Fehlermodi im Feld oder Dinge, über die sich die Menschen Sorgen machen, zu beschleunigen. Ich habe Gespräche mit mehreren Kunden geführt, aber an diesem Punkt konzentrieren wir uns auf diesen Punkt, um die vollständigen Funktionstests für diese Geräte, sowohl elektrisch als auch optisch, zu sichern.

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